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Z3와 Lean 4를 활용한 INT4 dot product 최적화: SWAR 비트핵 검증 기법
SIMD 미지원 환경에서 INT4 추론 성능을 극대화할 최적화 코드를 수학적으로 검증하는 기술적 가이드.
요약
최근 INT4 양자화가 머신러닝에서 널리 사용되지만, 네이티브 SIMD 명령어를 지원하지 않는 하드웨어에서는 연산 속도가 저하되는 문제가 발생합니다. 이를 해결하기 위해 개발자는 32비트 레지스터에 8개의 4비트 정수를 패킹하여 연산하는 SWAR(SIMD Within A Register) 기법을 활용했습니다. 기존에 수작업으로 비트 연산을 설계하던 방식의 오류를 방지하기 위해, Z3 SMT 솔버를 사용한 CEGIS(Counter-Example Guided Inductive Synthesis) 루프 기반의 자동 합성 파이프라인을 구축했습니다. 더 나아가 Lean 4 정리 증명기를 도입하여 해당 비트 연산 공식의 수학적 정확성을 엄격하게 검증했습니다. 이 방식은 복잡한 비트 핵(bit-hack)을 자동으로 생성하고 검증함으로써 하드웨어 제약이 있는 환경에서의 연산 효율성을 높이는 데 기여할 수 있습니다.
AI가 원문을 요약한 내용으로, 부정확할 수 있습니다.
원문 제목 Synthesizing and formally verifying a SWAR bit-hack for INT4 dot products using Z3 and Lean 4 [P]
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